Cadence IC 設計，深圳廣州廣東Cadence IC 設計與驗證||上海Cadence IC設計培訓深圳Cadence IC設計培訓||北京Cadence IC設計培訓武漢Cadence IC設計培訓，成都Cadence IC設計培訓，湖北Cadence IC設計培訓|深圳Cadence IC設計培訓，


嵌入式OS-Linux

Linux應用開發班
嵌入式Linux系統開發班

嵌入式Linux驅動開發班
Linux網絡工程及系統管理
QT應用開發培訓班
Linux內核剖析高級培訓班
嵌入式Linux實時系統與內核開發班
RT Linux開發高級班
嵌入式Linux/MiniGUI高級培訓班
Linux高手直通車-LPI全球認證課程
嵌入式Linux高級編程及網絡核心技術
Linux驅動、系統、應用全能班

嵌入式CPU--ARM

ARM開發培訓班

CortexM3+uC/OS培訓班

Cortex-M0開發培訓班

eCos驅動移植培訓

MIPS高級開發班

BlackFin培訓(基于uClinux平臺)

嵌入式OS--WinCE

單片機培訓

嵌入式硬件設計

Allegro Cadence PCB設計初級和中級班

Allegro Cadence PCB設計高級班

PCB Layout培訓-線路板設計全能班

Allegro Cadence PCB Layout高級班

Cadence SI 仿真分析工具專題班

信號完整性專題班

Altium Designer Layout高速硬件設計

嵌入式OS--VxWorks

PowerPC嵌入式系統/編譯器優化


PLC編程/變頻器/數控/人機界面

PLC編程系列培訓課程表
變頻器系列培訓課程表

人機界面、數控系列培訓課程表

開發語言/數據庫/軟硬件測試

Java/.NET/C#/SQL全能培訓班

Microsoft.NET Framework培訓

Windows內核修煉和內核安全

3G手機軟件測試、硬件測試

芯片設計/大規模集成電路VLSI

云計算、物聯網

開源操作系統Tiny OS開發

小型機系統管理

IBM AIX 6 Basics培訓班

IBM AIX 6 System II培訓班

汽車電子及其他

培訓報名

培訓報名
培訓課程
工作推薦
嵌入式合作(項目承接)

WEB在線客服

QQ客服一

QQ客服二

QQ客服三

雙休日、節假日及晚上可致電值班電話：021-51875830 值班手機：15921673576

值班QQ:

值班網頁在線客服,點擊交談：

最新出版物、峰會和認證

曙海產品研發和生產

公益培訓通知與資料下載

現代化的多媒體教室

曙海招聘啟示

曙海動態

VxWorks培訓班圓滿結業[2011-7-2]

Android培訓班圓滿結業[2011-6-26]

iPhone培訓班圓滿結業[2011-6-24]

DSP6000培訓班圓滿結業[2011-6-20]

MTK培訓班圓滿結業[2011-6-15]

FPGA培訓班圓滿結業[2011-6-10]

曙海成功實施Sony（索尼）LINUX開發企業培訓
[2011-5-19]

曙海成功實施比亞迪DSP2000系統開發與電機控制企業培訓
[2011-5-1]

曙海成功實施Intel（英特爾）Android開發企業培訓[2011-4-20]

曙海成功實施奇瑞汽車單片機開發企業培訓[2011-4-8]

第89期FPGA應用設計高級培訓班圓滿結業
[2011-4-3]

第31期iPhone培訓班圓滿結業
[2011-3-28]

第67期DSP6000系統開發培訓班圓滿結業
[2011-3-25]

第21期MTK培訓班完滿結業
[2010-4-1]

2009年“寒假培訓系列課程”
開始招生[2008-12-31]

曙海嵌入式學院隆重推出“寒
假培訓系列課程”[2007-12-16]

慶祝曙海創立5周年，部分課
程9折回饋學員[2006-03-12]

為普及嵌入式課程，學生
報名享受優惠[2005-08-03]

曙海嵌入式培訓課程全面
升級,啟用2.0版[2004-06-14]

曙海成為Altera公司
全球合作培訓機構[2002-10-07]

020321屆Linux驅動開發班
學生圓滿畢業[2002-04-25]

　　　　　　Cadence IC 設計與驗證

培養對象

  1.理工科背景，有志于數字集成電路設計工作的學生和轉行人員；
  2.需要充電，提升技術水平和熟悉設計流程的在職人員；
  3.集成電路設計企業的員工內訓。

入學要求

學員學習本課程應具備下列基礎知識：
◆電路系統的基本概念。

班級規模及環境

為了保證培訓效果，增加互動環節，我們堅持小班授課，每期報名人數限3到5人，多余人員安排到下一期進行。

上課時間和地點

上課地點：【上�！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【武漢分部】：佳源大廈（高新二路）【南京分部】：金港大廈(和燕路) 【成都分部】：領館區1號（中和大道）
最近開課時間(周末班/連續班/晚班）： Cadence IC開班時間：2025年9月15日..資深工程師授課....同心致遠，匠心服務......--即將開課--

學時

        ◆課時：共5天,30學時
        ◆外地學員：代理安排食宿（需提前預定）
        ☆注重質量
        ☆邊講邊練
        ☆合格學員免費推薦工作

        ☆合格學員免費頒發相關工程師等資格證書，提升您的職業資質

        專注高端培訓15年，曙海提供的證書得到本行業的廣泛認可，學員的能力
        得到大家的認同，受到用人單位的廣泛贊譽。

        ★實驗設備請點擊這兒查看★

最新優惠

◆團體報名優惠措施：兩人95折優惠，三人或三人以上9折優惠。注意：在讀學生憑學生證，即使一個人也優惠500元。

質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后免費提供半年的技術支持，充分保證培訓后出效果；
        3、培訓合格學員可享受免費推薦就業機會。 ☆合格學員免費頒發相關工程師等資格證書，提升您的職業資質。專注高端培訓13年，曙海提供的證書得到本行業的廣泛認可，學員的能力得到大家的認同，受到用人單位的廣泛贊譽。

　　　　　　　　　　　　　　　Cadence IC 設計與驗證

第一階段

1.　半導體和半導體器件基礎
　 1.1　半導體及其基本特性
　　 1.1.1　半導體導電性的特點
　　 1.1.2　半導體的導電機理
　　 1.1.3　空穴的導電作用
　　 1.1.4　能帶圖
　 1.2　雜質對半導體導電性能的影響
　　 1.2.1　施主雜質和N型半導體
　　 1.2.2　受主雜質和P型半導體
　　 1.2.3　多數載流子和少數載流子
　　 1.2.4　雜質的補償作用
　 1.3　半導體的電阻率
　　 1.3.1　半導體的電阻率的公式
　　 1.3.2　電阻率和雜質濃度的關系
　　 1.3.3　電阻率隨濕度的變化
　 1.4　非平衡載流子
　　 1.4.1　非平衡載流子的產生和復合
　　 1.4.2　擴散電流
　 1.5　PN結
　　 1.5.1　平衡PN結
　　 1.5.2　PN結的正向特性
　　 1.5.3　PN結的反向特性
　　 1.5.4　PN結的擊穿
　 1.6　MOS場效應晶體管
　　 1.6.1　MOS場效應晶體管的結構及工作原理
　　 1.6.2　MOS場效應晶體管的直流特性
　 1.7　雙極型晶體管
　　 1.7.1　雙極型晶體管的基本結構
　　 1.7.2　晶體管的電流傳輸
　　 1.7.3　晶體管的特性參數
　 1.8　習題
1. 半導體集成電路
　 1.1　集成電路的發明和發展
　　 1.1.1　集成電路的發明
　　 1.1.2　集成電路的發展
　　 1.1.3　集成電路的未來發展趨勢
　 1.2　集成電路的未來發展趨勢
　　 1.2.1　按器件結構類型分類
　　 1.2.2　按電路功能分析
　 1.3　CMOS集成電路
　　 1.3.1　CMOS集成電路的特點
　　 1.3.2　CMOS數字電路
　　 1.3.3　CMOS模擬電路
　 1.4　集成電路設計簡介
　　 1.4.1　設計途徑
　　 1.4.2　設計要求
　　 1.4.3　層次化設計方法

2.　集成電路制造工藝
　 2.1　氧化
　　 2.1.1　二氧化硅（SiO2）的性質及作用
　　 2.1.2　熱氧化生長SiO2
　 2.2　光刻與刻蝕
　　 2.2.1　光刻工藝流程
　　 2.2.2　光刻膠的基本屬性
　 2.3　摻雜
　　 2.3.1　擴散　
　　 2.3.2　離子注入
　 2.4　淀積
　　 2.4.1　物理氣相淀積
　　 2.4.2　化學氣相淀積
　 2.5　接觸與互連
　 2.6　CMOS工藝主要流程

實驗：
實驗一、Virtuoso Schematic Editor實戰演練
實驗目的：掌握電原理圖（schematic）設計輸入方法。

第二階段

3.　UNIX操作系統和Cadence軟件
3.1　UNIX操作系統基礎
3.1.1　有關目錄的操作
3.1.2　有關文件操作
3.1.3　文件存取權限
3.1.4 命令處理
3.1.5 使用vi
3.1.6 Linux操作系統簡介
3.2 Cadence軟件
3.2.1 EDA廠商簡介
3.2.2 Cadence軟件概述
3.3 電路圖的輸入
3.3.1 建立新庫
3.3.2 電路圖編輯窗
3.3.3 電路圖的輸入
3.3.4 電路圖的層次化設計
4. CMOS集成電路的版圖
4.1 MOS場效應晶體管的版圖實現
4.1.1 單個MOS管的版圖實現
4.1.2 MOS管陣列的版圖實現
4.2 版圖設計規則
4.2.1 概述
4.2.2 1.5μm硅柵CMOS設計規則
4.3 版圖系統的設置
4.3.1 建立版圖庫
4.3.2 對層選擇窗進行設置
4.3.3 版圖編輯窗的設置
4.3.4 使用Option菜單進行版圖編輯窗

實驗：
實驗二、 Spectre Simulation實戰演練
實驗目的：掌握電路特性仿真方法

第三階段

4. CMOS集成電路的版圖
4.1 MOS場效應晶體管的版圖實現
4.1.1 單個MOS管的版圖實現
4.1.2 MOS管陣列的版圖實現
4.2 版圖設計規則
4.2.1 概述
4.2.2 1.5μm硅柵CMOS設計規則
4.3 版圖系統的設置
4.3.1 建立版圖庫
4.3.2 對層選擇窗進行設置
4.3.3 版圖編輯窗的設置
4.3.4 使用Option菜單進行版圖編輯窗
5.版圖的建立
5.1 設置輸入層
5.2 屏幕顯示畫圖區
5.3 建立幾何圖形
5.4 版圖的編輯
5.4.1 設置層的可視性
5.4.2 測量距離或長度
5.5.3 圖形顯示
5.5.4 選擇目標
5.5.5 改變圖形的層次
5.5.6 加標記
5.6 棍棒圖
5.7 版圖設計方法概述
5.7.1 版圖設計方法
5.7.2 層次化設計

實驗：
實驗三、 Virtuoso Layout Editor實戰演練
實驗目的：使用EDA工具進行版圖設計。

第四階段

6. 版圖驗證
6.1 概述
6.1.1 版圖驗證的項目
6.1.2 Cadence的版圖驗證工具
6.1.3 版圖驗證過程簡介
6.2 DivaDRC規則文件的建立
6.3 Dracula規則文件
6.3.1 Dracula規則文件的結構
6.3.2 建立Dracula規則文件
6.3.3 Dracula規則文件至Diva規則文件的轉換
6.4 運行Diva DRC
6.5 運行Dracula DRC
6.5.1 驗證步驟
6.5.2 結果分析
6.6 運行Dracula LVS
6.6.1 LVS原理
6.6.2運行過程
6.6.3輸出報告解讀
6.6.4錯誤的糾正
6.7關于ERC

7. 外圍器件及阻容元件設計
7.1 特殊尺寸器件的版圖設計
7.1.1 大尺寸器件
7.1.2 倒比管
7.2.電阻、電容及二極管的版圖設計
7.2.1 MOS集成電路中的電阻
7.2.2 MOS集成電路中的電容器
7.2.3 集成電路中的二極管
7.3 CMOS集成電路的靜電放電保護電路
7.4 壓焊塊的版圖設計
7.5 電源和地線的設計
7.5.1電源和地線在外圍的分布框架
7.5.2電源和地線在內部的分布

實驗：
實驗四、Diva Interactive Verification
實驗目的：掌握DRC和LVS驗證方法

第五階段

8. 模擬和雙極型集成電路的版圖設計
8.1 模擬CMOS集成電路
8.1.1 模擬集成電路和數字集成電路的比較
8.1.2 MOS器件的對稱性
8.1.3 無源元件
8.1.4 連線
8.1.5 靜電放電保護
8.1.6 襯底耦合
8.2 鋁柵CMOS集成電路
8.2.1 鋁柵CMOS集成電路的版圖計
8.2.2 鋁柵CMOS集成電路版圖實例
8.3 雙極型集成電路
8.3.1 雙極型晶體管的版圖圖形
8.3.2 雙極型集成電路版圖設計的原則和步驟

實驗：
實驗五、Active HDL調試、仿真Verilog HDL
實驗目的：熟悉Active HDL仿真軟件的使用，初步掌握利用Verilog HDL設計數字系統的基本步驟。
實驗六 NC-Verilog Simulator實驗
實驗目的：NC_verilog仿真器的使用，包括編譯、運行和仿真。

第六階段

9. 版圖設計技巧和實例
9.1 人工全定制版圖設計方法
9.2 常用版圖設計技巧
9.3 版圖實例
9.3.1 CMOS門電路
9.3.2 CMOS SRAM單元及陣列
9.3.3 CMOS D觸發器
9.3.4 CMOS放大器
9.3.5 雙極集成電路

實驗：
實驗七 Ambit BuildGates邏輯綜合實驗
實驗目的：BuildGates邏輯綜合方法，靜態時序分析。
實驗八、Silicon Ensemble 布局布線
實驗目的：
學習使用Silicon Ensemble進行系統級約束布局布線。