芯片設計、實現(xiàn)與FPGA驗證 |
培養(yǎng)目標 |
通過培訓使學員專項技能水平達到相當于中級技術等級;掌握集成電路基本工藝設計知識、版圖設計基礎知識,了解半導體基礎理論,能熟練使用EDA軟件軟件進行基本版圖設計。 |
培養(yǎng)對象 |
1.理工科背景,有志于數(shù)字集成電路設計工作的學生和轉行人員;
2.需要充電,提升技術水平和熟悉設計流程的在職人員;
3.集成電路設計企業(yè)的員工內訓。
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入學要求 |
學員學習本課程應具備下列基礎知識:
◆電路系統(tǒng)的基本概念。 |
班級規(guī)模及環(huán)境 |
為了保證培訓效果,增加互動環(huán)節(jié),我們堅持小班授課,每期報名人數(shù)限3到5人,多余人員安排到下一期進行。 |
上課時間和地點 |
上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院
【北京分部】:北京中山學院/福鑫大樓 【武漢分部】:佳源大廈(高新二路) 【南京分部】:金港大廈(和燕路) 【成都分部】:領館區(qū)1號(中和大道)
最近開課時間(周末班/連續(xù)班/晚班): 芯片實現(xiàn)開班時間:2024年1月8日 |
學時 |
◆課時: 共5天,30學時
◆外地學員:代理安排食宿(需提前預定)
☆注重質量
☆邊講邊練
☆合格學員免費推薦工作
☆合格學員免費頒發(fā)相關工程師等資格證書,提升您的職業(yè)資質
專注高端培訓15年,曙海提供的證書得到本行業(yè)的廣泛認可,學員的能力
得到大家的認同,受到用人單位的廣泛贊譽。
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最新優(yōu)惠 |
◆團體報名優(yōu)惠措施:兩人95折優(yōu)惠,三人或三人以上9折優(yōu)惠 。注意:在讀學生憑學生證,即使一個人也優(yōu)惠500元。 |
質量保障 |
1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
2、培訓結束后免費提供半年的技術支持,充分保證培訓后出效果;
3、培訓合格學員可享受免費推薦就業(yè)機會。 ☆合格學員免費頒發(fā)相關工程師等資格證書,提升您的職業(yè)資質。專注高端培訓13年,曙海提供的證書得到本行業(yè)的廣泛認可,學員的能力得到大家的認同,受到用人單位的廣泛贊譽。 |
芯片設計、實現(xiàn)與FPGA驗證 |
第一階段 芯片實現(xiàn)
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Link-To-Layout邏輯綜合;
靜態(tài)時序分析(STA);
時序驅動的自動布局布線;
邏輯綜合(Logic Synthesis);
可測性設計(DFT)。
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物理綜合;
靜態(tài)時序分析(STA);
芯片規(guī)劃(Planning);
時序驅動的布局布線;
可測性設計(DFT);
低功耗設計。
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物理綜合;
靜態(tài)時序分析(STA)Sign off;
RTL-to-GDS流程;
可測性設計(DFT);
低功耗設計;
IP嵌入設計。
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第二階段 芯片測試、FPGA設計與驗證
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芯片測試基礎;
芯片制造工藝;
芯片測試知識;
芯片測試項目和常用輔助工具;
項目設計實踐(C)。
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數(shù)字電路邏輯設計;
CMOS集成電路設計原理;
硬件描述語言HDL及FPGA設計方法;
FPGA現(xiàn)場集成;
項目設計實踐(C)。
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